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MPC8349E-mITXE Board
Table 22. Core PLL Ratio
CCB
CLKIN
SPMF
[0–3]
CCB
clock:
CLKIN
COREPLL
[0–6]
Core CCB Clock:
Frequency CLKIN Ratio
Ratio
66.666 MHz
66.666 MHz
66.666 MHz
66.666 MHz
66.666 MHz
66.666 MHz
66.666 MHz
66.666 MHz
66.666 MHz
0101
0100
0011
0101
0100
0011
0101
0100
0011
333 MHz
266 MHz
200 MHz
333 MHz
266 MHz
200 MHz
333 MHz
266 MHz
200 MHz
5:1
4:1
3:1
5:1
4:1
3:1
5:1
4:1
3:1
00 0010 0
00 0010 1
00 0010 0
01 0001 1
00 0010 0
00 0010 1
00 0001 0
01 0001 1
01 0010 0
667 MHz
667 MHz
600 MHz
500 MHz
533 MHz
500 MHz
333 MHz
400 MHz
400 MHz
2:1
2.5:1
3:1
1.5:1
2:1
2.5:1
1:1
1.5:1
2:1
1.6.4.2
Example of Changing the RCW Register Using Uboot
Issue the following uboot commands to change from 533/266 to 400/266 (CPU/CCB):
cp.b FE000000 100000 40
mw.b 100008 23 8
md 100000
erase FE000000 FE00FFFF
md FE000000
cp.b 100000 FE000000 40
md FE000000
reset
To make the changes take effect, power off the system and then power it on. Figure 26 shows the change
in bit settings from these uboot commands. There is no change in the SPMF field since 0b0100 is the
default value representing the 266 MHz CCB frequency. The COREPLL field is changed from the default
value of 0b000_0100 representing 533 MHz to the new value of 0b010_0011 representing 400 MHz core
frequency.
Field
0
—
3
4
SPMF
7
8
—
9
COREPLL
15
Bit Setting
0
1
0
0
0
1
0
0
0
0
1
0
0
0
1
1
Figure 26. Reset Configuration Word Low (RCW) Bit Settings Example
MPC8349E-mITXE Reference Design Platform User’s Guide, Rev. 2
36
Preliminary—Subject to Change Without Notice
Freescale Semiconductor
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